操作數改進

1、兩態和四態類型數據的運算
全兩態類型的運算使用Verilog運算法則
Verilog對大多數操作數類型的混合運算都制定了相應規則。
SystemVerilog包含了Verilog沒有涉及的兩態類型數據的運算，從而對這些規則進行了擴展。對SystemVerilog新類型的運算按照相同的Verilog規則進行。這就意味著對結果的每一位，大部分運算會返回0、1或X。當對兩態類型進行運算時，一般很少會遇到X結果。不過對兩態類型的一些運算會產生X，如除以0產生的錯誤。
2、類型強制轉換
SystemVerilog增加了類型強制轉換操作符
類型強制轉換使設計者可以指定在表達式計算期間的任何地方進行轉換，而不只是作為賦值的一部分。

類型強制轉換的語法為：type'(表達式)

3、尺寸強制轉換
向量的位寬可以強制轉換為不同尺寸
允許將表達式的位數強制轉換為不同的尺寸?？梢允褂蔑@示強制轉換設置操作數的位數，也可以設置操作結果的位數。

尺寸強制轉換操作的語法為 size'(表達式)logic[15:0] a,b,c,sum;//16位寬 logic carry;//1位寬 sum = a+16'(5);//轉換操作 {carry,sum} =17'(a+3);//轉換結果 sum=a+16'(b-2)/c;//轉換中間結果

如果轉換后的表達式位數比原來小，則截去表達式左端最高位。如果轉換后的表達式位數比原來大，則進行高位擴展。無符號表達式用0進行擴展。有符號表達式用符號位擴展。這種規則與將一個表達式賦值給位數不同的變量或線網時的操作是一樣的。
4、符號強制轉換
SystemVerilog確定操作結果是有符號還是無符號數的規則Verilog一致。SystemVerilog還可以顯示強制轉換值的符號。不管是操作數還是操作的結果都可以強制轉換符號。

符號強制轉換操作的語法為 signed'(表達式) unsigned'(表達式)sum = signed'(a) + signed'(a);//強制轉換操作數 if(unsigned'(a-b) <=5)//強制轉換中間結果

SystemVerilog的符號強制轉換操作與Verilog中的系統函數$signed和 $unsigned執行相同的轉換。

總結

以上是生活随笔為你收集整理的操作数改进的全部內容，希望文章能夠幫你解決所遇到的問題。

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