//邏輯與
wire c;
wire [3:0] a=4’b0101；
wire [3:0] b=4’b1110;
c=a && b；
//c=1
邏輯與&&表示的是交集，2個(gè)條件同時(shí)成立，結(jié)果才為真
wire [3:0] c;
wire [3:0] a=4’b0101；
wire [3:0] b=4’b0000;
c=a & b；
//c=4’b0000
按位與
wire [3:0] c;
wire [3:0] a=4’b0101；
wire [3:0] b=4’b0100;
wire c=a & b；
//c=0100

總結(jié)

以上是生活随笔為你收集整理的基础篇-verilog-按位与和逻辑与的全部?jī)?nèi)容，希望文章能夠幫你解決所遇到的問(wèn)題。

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