在quartus 和 ISE 里直接调用modelsim的方法(转)
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在quartus?和?ISE?里直接調(diào)用modelsim的方法
在這個(gè)論壇中我學(xué)到了很多東西,所以總結(jié)點(diǎn)東西做為回報(bào)。
大家是不是被modelsim折磨的死去活來(lái)呢?是不是覺(jué)得在沒(méi)有人指點(diǎn)下,學(xué)習(xí)modelsim就象是黑暗中摸索,everyting is black!.如果我們能直接在quartus中調(diào)用modelsim那么我們就可以直接得到我們的仿真波形,不用在modelsim?中建立工程,加入文件,編譯,加載波形,運(yùn)行等等煩瑣的工序,而且后仿的時(shí)候還經(jīng)常會(huì)出現(xiàn)找不到庫(kù)的情況,這對(duì)出學(xué)者來(lái)說(shuō)更是郁悶的要死。直接調(diào)用可以進(jìn)行rtl級(jí)仿真和門(mén)級(jí)仿真。一個(gè)前仿一個(gè)后仿。因此為了方便大家我特意研究了一下如何實(shí)現(xiàn)直接調(diào)用。以下是結(jié)論。
在ISE環(huán)境中。
1,edit->preferences:ise General->Intergrated tools
?
??????設(shè)置:Model Tech Simulator:????????C:\\Modeltech_6.0\\win32\\modelsim.exe(看你裝在哪里了)
2,在?Sources in Project窗口里的?器件名稱(chēng)上單擊左鍵。然后雙擊:Compile HDL Simulation Library
3,建立testbench。方法:Project->new source.??vhdl?是:VHDL module???verilog hdl?是:verilog??test fixture.
4,單擊testbench?文件,就可以看到下面框框里的四個(gè)仿真級(jí)別。雙擊分別進(jìn)行仿真。
5。用眼睛看modelsim?出來(lái)的波形。
在Quartus?中。
1,我的電腦->屬性->高級(jí)->環(huán)境變量.
在系統(tǒng)變量里增加:QUARTUS_INIT_PATH
?C:\\Modeltech_6.0\\win32??(看你裝在哪里了)
2,Assignments->settings->ead tool setting:Simulation:
?tool name:modelsim(verilog)(我用的是這個(gè),用啥選啥)
別的能填的就填一下。但是下邊的兩個(gè)按紐還是要設(shè)置的,因?yàn)橐付?/span>test bench文件才能仿真的。所以先寫(xiě)好testbench。然后把路徑設(shè)置好。那兩個(gè)按紐一個(gè)是前仿真,一個(gè)是后仿真。不知道寫(xiě)testbench大家會(huì)不?就是:process->start->start testbench template writer
然后把生成的文件打開(kāi),改一改就行了。在哪里打開(kāi)?看屏幕下面的提示啊。
3。現(xiàn)在就可以進(jìn)行仿真了。
?tools -> eda simulation tool->run RTL simulaiton...前仿
?tools -> eda simulation tool->run Gate Level simulaiton?后仿。
4。用眼睛看波形。
補(bǔ)充一下:
在ISE環(huán)境中,選中某個(gè)仿真(Behavioral或者Post fit等等)單機(jī)Process-?Properties-可以設(shè)置仿真的時(shí)間、vism vlog vcom參數(shù)或者指定DO file。
Quartus6就更方便了。
在tools->options->EDA Tool Options里面設(shè)置modelsim synplify之類(lèi)的路徑。
然后按照樓主的方法設(shè)置assignment settings?就ok了。
轉(zhuǎn)載于:https://www.cnblogs.com/habyjingloveDY/p/3437005.html
總結(jié)
以上是生活随笔為你收集整理的在quartus 和 ISE 里直接调用modelsim的方法(转)的全部?jī)?nèi)容,希望文章能夠幫你解決所遇到的問(wèn)題。
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