七人表决器VHDL语言
生活随笔
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七人表决器VHDL语言
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七人表決器:七人表決,如果大于等于四人同意,則輸出為1,否則輸出為0。
LIBRARY IEEE; --七人表決器 USE IEEE.STD_LOGIC_1164.ALL; ENTITY VOTE ISPORT(a,b,c,d,e,f,g:IN STD_LOGIC;o:OUT STD_LOGIC); END ENTITY VOTE; ARCHITECTURE VT OF VOTE ISBEGINPROCESS(a,b,c,d,e,f,g)VARIABLE sum:INTEGER RANGE 0 TO 8;BEGIN IF a='1' THENsum:=1;ELSEsum:=0;END IF;IF b='1' THENsum:=sum+1;ELSEsum:=sum;END IF;IF c='1' THENsum:=sum+1;ELSEsum:=sum;END IF;IF d='1' THENsum:=sum+1;ELSEsum:=sum;END IF;IF e='1' THENsum:=sum+1;ELSEsum:=sum;END IF;IF f='1' THENsum:=sum+1;ELSEsum:=sum;END IF;IF g='1' THENsum:=sum+1;ELSEsum:=sum;END IF;IF sum>=4 THENo<='1';ELSEo<='0';END IF;END PROCESS;END ARCHITECTURE VT;總結
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