脈沖同步電路

題目解析
從A時鐘域提取一個單時鐘周期寬度脈沖，然后在新的時鐘域B建立另一個單時鐘寬度的脈沖。
A時鐘域的頻率是B時鐘域的10倍；A時鐘域脈沖之間的間隔很大，無需考慮脈沖間隔太小的問題。
電路的接口如下圖所示。data_in是脈沖輸入信號，data_out是新的脈沖信號；clk_fast是A時鐘域時鐘信號，clk_slow是B時鐘域時鐘信號；rst_n是異步復位信號。

題目解析

上圖中最左端的數據選擇器和寄存器，組成了快時鐘域下的翻轉電路；中間的兩個寄存器是兩級同步器；最后一個寄存器和異或門組成邊沿檢測電路。

`timescale 1ns/1nsmodule pulse_detect(input clk_fast , input clk_slow , input rst_n 創作挑戰賽新人創作獎勵來咯，堅持創作打卡瓜分現金大獎

總結

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