計算機組成原理試題A.doc

黑龍江大學2006-2007學年第2學期考試試卷 裝訂線20062007學年第2學期計算機組成與體系結構試卷(A) (院系計算機科學與技術 專業計算機科學與技術 年級2005考核形式閉卷 )題 號一二三卷面分折合分(占 )實驗(占 )平時(占 )總分評卷人分 數得 分得分評卷人 一、選擇題(在每個小題四個備選答案中選出一個正確答案，填在題末括號里)(每題1分，總計10分)1 從器件角度看，計算機經歷了四代變化。但從系統結構看，至今絕大多數計算機仍屬于型計算機。A.并行 B.馮.諾依曼 C.智能 D.實時處理2 關運算器的描述，是正確的。A.只做加法 B.只做算術運算C.既做算術運算又做邏輯運算 D.只做邏輯運算3下列數中最小的數是。A.(100101)2 B.(50)8 C.(100010)BCD D.(625)164表示法主要用于表示浮點數中的階碼。A.原碼 B.補碼 C.反碼 D.移碼5 長32位，其中1位符號位，31位表示尾數。若用定點小數表示，則最大正小數為。A (1 2-32) B (1 2-31) C 2-32 D 2-316 儲器是計算機系統中的記憶設備，它主要用來。A.存放數據 B.存放程序 C.存放微程序 D.存放數據和程序7 以下四種類型指令中，執行時間最長的是。A.RR型指令 B.RS型指令 C.SS型指令 D.程序控制指令8 單地址指令為了完成兩個數的算術運算，除地址指明的一個操作數外，另一個操作數常采用尋址方式。A.堆棧 B.立即 C.隱含 D.間接9某計算機字長32位，其存儲容量為4MB，若按半字編址，它的尋址范圍是。 A 4MB B 2MB C 2M D 1M10 貯器和CPU之間增加cache的目的是。A 解決CPU和主存之間的速度匹配問題B 擴大主存貯器容量C 擴大CPU中通用寄存器的數量D 既擴大主存貯器容量，又擴大CPU中通用寄存器的數量得分評卷人 二、填空題(每空1分，總計20分)1 的值用十進制表示為A。2 Cache是一種A存儲器，是為了解決CPU和B之間C上不匹配而采用的一項重要硬件技術。3 5選擇型DMA控制器在物理上可以連接A個設備，在邏輯上只允許連接B個設備，適合連接C設備。4 指令格式是指指令用A表示的結構形式，通常由B字段和C字段組成。5 DMA和CPU分時使用內存的三種方式是A，B，C。6 若浮點數格式中介碼的基數已定，尾數用規格化表示，浮點數的表示范圍取決于A的位數，精度取決于B的位數。7 指令格式中，操作碼字段表征指令的A，地址碼字段指示B。8 模4交叉存儲器是一種A存儲器，它有B個存儲模塊，每個模塊有它自己的地址存儲器，和C寄存器。得分評卷人 三、已知 x - 0.01111 ，y 0.11001，求 x 補 ， -x 補 ， y 補 ， -y 補 ，x y ，x y (總計8分)院 系年 級專 業姓 名學 號考試課程裝訂線裝訂線得分評卷人 四、設x 15, y -13,采用補碼輸入，用帶求補器的原碼陣列乘法器求乘積xy 并用十進制數乘法進行驗證。(10分)得分評卷人 五、某機器中，已知配有一個地址空間為00001FFF16的ROM區域，現在用一個SRAM芯片(8K8位)形成一個16K16位的ROM區域，起始地址為(2000)16 。假設SRAM芯片有CS和WE控制端，CPU地址總線A15A0 ，數據總線為D15D0 ，控制信號為R / W(讀 / 寫)，MREQ(當存儲器讀或寫時，該信號指示地址總線上的地址是有效的)。要求(1)滿足已知條件的存儲器，畫出地址譯碼方案。(2)畫出ROM與RAM同CPU連接圖。(12分)院 系年 級專 業姓 名學 號考試課程裝訂線裝訂線得分評卷人 六、圖1是從實時角度觀察到的中斷嵌套。試問，這個中斷系統可以實行幾重 中斷并分析圖1的中斷過程。12分 圖1得分評卷人 七、假設機器字長16位，主存容量為128K字節，指令字長度為16位或32位，共有128條指令，設計計算機指令格式，要求有直接、立即數、相對、基值、間接、變址六種尋址方式。(14分)院 系年 級專 業姓 名學 號考試課程裝訂線裝訂線得分評卷人 八、某計算機的數據通路如圖2所示，其中M主存， MBR主存數據寄存器， MAR主存地址寄存器， R0-R3通用寄存器， IR指令寄存器， PC程序計數器(具有自增能力)， C、D暫存器， ALU算術邏輯單元(此處做加法器看待)， 移位器左移、右移、直通傳送。所有雙向箭頭表示信息可以雙向傳送。請按數據通路圖畫出“ADD(R1)，(R2)”指令的指令周期流程圖。該指令的含義是兩個數進行求和操作。其中源操作地址在寄存器R1中，目的操作數尋址方式為自增型寄存器間接尋址(先取地址后加1)。(14分) 圖2院 系年 級專 業姓 名學 號考試課程裝訂線共 4 頁 第 頁 負責人簽字

總結

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