微機(jī)原理與接口技術(shù)習(xí)題集匯總.doc

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29.9 積分

.word格式,第二章 微機(jī)基本組成及工作原理1.1微型機(jī)的基本結(jié)構(gòu)一、單項(xiàng)選擇題1．計(jì)算機(jī)中的運(yùn)算器和控制器集成在一塊芯片上稱為( )。A．微型處理機(jī) B．單片機(jī)C．微處理器 D．單敿機(jī)2．微控制器是指( )。 A．微處理器 B．微型計(jì)算機(jī) C．單敿機(jī) D．單片機(jī) 4．微型計(jì)算機(jī)中的運(yùn)算器，將運(yùn)算結(jié)果的一些特征標(biāo)志寄存在( )中。 A． SP B． IP C．AX D．FR5．微處理器內(nèi)部的控制器是由( )組成。 A．寄存器陣列 B．指令寄存器、指令譯碼器及定時(shí)控制電路 C．ALU與內(nèi)存 D．ALU與寄存器 6．微型計(jì)算機(jī)各部件之間是用( )連接起來的。 A．系統(tǒng)總線 B．AB C．CB D．DB 7．通常計(jì)算機(jī)系統(tǒng)中的外圍設(shè)備是指( )。A．外存儲(chǔ)器、輸入設(shè)備及輸出設(shè)備 B．外存儲(chǔ)器、輸入設(shè)備 C．外存儲(chǔ)器、輸出設(shè)備 D．輸入設(shè)備、輸出設(shè)備9．單片機(jī)是( )。 A．微處理器 B．微型計(jì)算機(jī) C．微機(jī)系統(tǒng) D．中央處理器10．單片機(jī)是在一個(gè)集成電路芯片中集成了( )。 A．微處理器和I/O接口 B微處理器和RAM C．微處理器和ROM D微處理器、I/O接口、RAM11．總線是微處理器、內(nèi)存儲(chǔ)器和I/O接口之間相互交換信息的公共通路?？偩€中的控制總線是( )的信息通路。A．微處理器向內(nèi)存儲(chǔ)器傳送的命令信號(hào) B．微處理器向I／O接口傳送的命令信號(hào) C．外界向微處理器傳送的狀態(tài)信號(hào) D．上述三種信號(hào) 12．連接微處理器和內(nèi)存儲(chǔ)器以及I/O接口之間的總線是( )。 A．片總線 B．內(nèi)總線 C．系統(tǒng)總線 D．外總線二、判斷說明題1．計(jì)算機(jī)中的運(yùn)算器，控制器和內(nèi)存儲(chǔ)器合稱為中央處理機(jī)。 ( )2．微處理機(jī)就是微型計(jì)算機(jī)。 ( )3．微處理機(jī)就是中央處理機(jī)CPU。 ( )4．通常所說的微型計(jì)算機(jī)是不包含系統(tǒng)軟件及應(yīng)用軟件的。 ( )5．通常所說的微型計(jì)算機(jī)系統(tǒng)就是指微型計(jì)算機(jī)。 ( )6．通常所說的微型計(jì)算機(jī)系統(tǒng)就是指微型計(jì)算機(jī)及足夠的軟件所構(gòu)成。 ( )7．若將微型計(jì)算機(jī)集成在一片芯片上即構(gòu)成單敿機(jī)。 ( )8．單敿機(jī)如TP-81、TP-86 都是計(jì)算機(jī)系統(tǒng)。 ( )9．目前人們常把微型計(jì)算機(jī)系統(tǒng)稱為個(gè)人計(jì)算機(jī)。 ( )12．對(duì)于片內(nèi)總線而言，用戶無法直接控制其內(nèi)部工作的。 ( )13．片內(nèi)總線就是微型計(jì)算機(jī)引腳信號(hào)。 ( )14．外部總線就是系統(tǒng)總線或板級(jí)總線。 ( )15．微型計(jì)算機(jī)總線就是外部總線。 ( )16．片內(nèi)總線就是內(nèi)部總線。 ( )17．微型計(jì)算機(jī)系統(tǒng)中采用總線結(jié)構(gòu)，所以部件之間傳送信息時(shí)必須分時(shí)處理。 ( )18．數(shù)據(jù)總線上傳送的信息是數(shù)據(jù)，也可能是指令代碼。 ( )三、簡答題1．簡述微處理器的內(nèi)部結(jié)構(gòu)。2．簡述微型計(jì)算機(jī)的幾個(gè)主要組成部分。3．簡述微型計(jì)算機(jī)系統(tǒng)中所用總線的類型。4．簡述微型計(jì)算機(jī)系統(tǒng)組成。1.3 IBMPC機(jī)特點(diǎn)一、單項(xiàng)選擇題3．自Intel 80386芯片問世后，至今集成度已超過100萬管子／片，主頻達(dá)100MHz以上的微處理器芯片有( )。 A．80286 B．TP-86 C．8051 D．Pentium Ⅲ8．8086是( )。 A．單片機(jī) B．單敿機(jī) C．微處理器 D．微機(jī)系統(tǒng)二、判斷說明題10．Pentium Ⅲ是高性能的32位微處理器。 ( )11．Pentium MMX是提高PC機(jī)處理多媒體和通訊能力而推出的新一代微處理器。 ( )1.1 練習(xí)題參考解答一、單項(xiàng)選擇題1．C2．D3．D4．D5．B6．A7．A8．C9．B10．D11．D12．A二、多項(xiàng)選擇題1．ACEF2．ABDE三、判斷說明題1．(×) “中央處理器”改為“主機(jī)”。2．(×) “就是”改為“不是”。3．(√) 4．(√)5．(×) “就是”改為“不是”。6．(×) 微型計(jì)算機(jī)系統(tǒng)是以微型計(jì)算攺為主體，再配備外圍設(shè)備(外存儲(chǔ)器、輸入輸出設(shè)備)及軟件系統(tǒng)即可構(gòu)成。7．(×) “單敿機(jī)”改為“單片微型計(jì)算機(jī)”。8．(√) 9．(√) 10．(√) 11．(√) 12．(√) 13．(√)14．(×) “就是”改為“不是”。15．(×) “外部總線”改為“內(nèi)總線”。16．(×) “就是”改為“不是”。 17．(√) 18．(√)四、簡答題1．微處理器內(nèi)部結(jié)構(gòu)由三部分組成。(1)運(yùn)算器：由算術(shù)運(yùn)算和邏輯運(yùn)算部件組成，用于數(shù)據(jù)的算術(shù)邏輯運(yùn)算，運(yùn)算結(jié)果的一些特征由FR寄存。(2)控制器：由指令寄存器、指令譯碼器以及定時(shí)與控制電路組成。根據(jù)譯碼結(jié)果，以一定時(shí)序發(fā)出相應(yīng)的控制信號(hào)，用來控制指令的執(zhí)行。(3)寄存器陣列(組)：由一組通用寄存器組和專用寄存器組成。2．微型計(jì)算機(jī)的基本結(jié)構(gòu)是由微處理器、內(nèi)存儲(chǔ)器。I/O接口電路和總線組成。其中總線是由數(shù)據(jù)總線DB、地址總線AB、控制總線組成。微處理器是核心部件，它決定微型計(jì)算機(jī)各種功能及技術(shù)指標(biāo)。存儲(chǔ)器存放程序、數(shù)據(jù)和結(jié)果。I／O接口電路又稱I/O適配器，用于連接微型計(jì)算機(jī)與外圍設(shè)備的邏輯電路。為CPU和外圍設(shè)備交換數(shù)據(jù)提供各種通道?？偩€是微處理器、內(nèi)存儲(chǔ)器和I/O接口之間相互交換信息的公共通路。3．微型計(jì)算機(jī)系統(tǒng)中有三類總線：(1)片總線又稱為元件級(jí)總線，它是微處理器的引腳信號(hào)。(2)內(nèi)總線(I－BUS)，又稱為系統(tǒng)總線、微機(jī)總線或板級(jí)總線。(3)外總線(E－BUS)，又稱為通信總線。4．微型計(jì)算機(jī)系統(tǒng)是以微型計(jì)算攺為主體，再配備外圍設(shè)備(外存儲(chǔ)器、輸入輸出設(shè)備)及軟件系統(tǒng)即可構(gòu)成。其中軟件系統(tǒng)是由系統(tǒng)軟件和應(yīng)用軟件組成。系統(tǒng)軟件包括操作系統(tǒng)、數(shù)據(jù)庫管理系統(tǒng)。各種高級(jí)語言的編譯程序、匯編程序、調(diào)試程序、編輯程序等。 應(yīng)用軟件是由各學(xué)科、各領(lǐng)域諸種應(yīng)用程序組成。第5章 存儲(chǔ)器及其接口5.1 存儲(chǔ)器的基本結(jié)構(gòu)、分類一、單項(xiàng)選擇題7．存儲(chǔ)器系統(tǒng)中，通常SRAM芯片所用控制信號(hào)有( )。A. 、、READY B. 、、C. 、、ALE D. 、8．當(dāng)內(nèi)存儲(chǔ)器系統(tǒng)中內(nèi)存儲(chǔ)器芯片較少時(shí)，其片選信號(hào)可以采用( )。A. 74LS 138 。省略部分。的上升沿產(chǎn)生，也就是只能用硬件啟動(dòng)計(jì)數(shù)器，不能用軟件啟動(dòng)計(jì)數(shù)器。 (2)輸出OUT為一單穩(wěn)態(tài)負(fù)脈沖，其脈沖寬度為計(jì)數(shù)初值N個(gè)CLK時(shí)鐘脈沖的周期之和。 (3)形成單穩(wěn)態(tài)脈沖過程中，可以重復(fù)觸發(fā)，使OUT輸出的負(fù)脈沖加寬。 (4)初始值由程序?qū)懭?#xff0c;所以改變計(jì)數(shù)初值就可以改變輸出負(fù)脈沖的OUT寬度。 11．答：輸出寬度取決于計(jì)數(shù)初值N，輸出OUT負(fù)脈沖寬度為計(jì)數(shù)初值N個(gè)CLK脈沖周期之和。 欲改變自脈沖寬度方法為(1)改變計(jì)數(shù)初始值N(2)在形成單穩(wěn)態(tài)脈沖過程中，若在GATE端再一次產(chǎn)生由低變高的觸發(fā)信號(hào)，則又將CR內(nèi)容裝入CE，又從初始狀態(tài)開始計(jì)數(shù)過程，到輸出OUT端將延長輸出負(fù)脈沖寬度。 12答：方式2的特點(diǎn)如下： (1)方式2工作過程中，計(jì)數(shù)初始值寄存器的內(nèi)容能自動(dòng)地、重復(fù)地裝入執(zhí)行部件CE中，只要時(shí)鐘脈沖周期CLK是周期性脈沖序列，在輸出瑞OUT上就能連續(xù)地輸出周期性分頻信號(hào)。 (2)方式2的啟動(dòng)計(jì)數(shù)器可以使用軟件方法，也可以使周硬件方法。 (3)在某一已知的頻率CLK脈沖信號(hào)下，改變計(jì)數(shù)初值，可以獲得不同速率的OUT輸出信號(hào)。 (4)方式2輸出負(fù)脈沖寬度為一個(gè)CLK脈沖周期，正脈沖寬度為計(jì)數(shù)初值N-1個(gè)CLK脈沖周期之和。 方式2的應(yīng)用： 方式2主要應(yīng)用于作為分頻器和時(shí)基信號(hào)，它能方便地從系統(tǒng)時(shí)鐘中獲得符合某種頻率要求的標(biāo)準(zhǔn)信號(hào)，供系統(tǒng)使用。 13．答：方式3的特點(diǎn)如下： (1)方式3計(jì)數(shù)過程是計(jì)數(shù)執(zhí)行單元內(nèi)容減2。 (2)方式3的工作過程中，計(jì)數(shù)初始值寄存器CR內(nèi)容(偶數(shù))或計(jì)數(shù)初始值寄存器CR－l的內(nèi)容(奇數(shù))能自動(dòng)裝入計(jì)數(shù)執(zhí)行單元CE中，只要時(shí)鐘脈沖周期CLK是周期性脈沖序列、則輸出端將連續(xù)輸出方波，從而實(shí)現(xiàn)一個(gè)方波發(fā)生器的輸出要求。 (3)計(jì)數(shù)器啟動(dòng)過程也是軟件啟動(dòng)和硬件啟動(dòng)兩種。 (4)改變計(jì)數(shù)初值，OUT端將輸出不同頻率的方波，從而實(shí)現(xiàn)方波發(fā)生器輸出的要求。 方式3應(yīng)用： 主要用于方波脈沖發(fā)生器和波特率發(fā)生器，串行通信中所需要的時(shí)鐘信號(hào)，可用8253－5方式3提供。 14．答：當(dāng)初始值寄存器中的初始值N可是偶數(shù)時(shí)，減法計(jì)數(shù)過程變?yōu)闇p2計(jì)數(shù)，即每來一個(gè)CLK脈沖，CE內(nèi)容城2。經(jīng)過N／2個(gè)CLK脈沖后，CE為零，使輸出OUT為低電平。同時(shí)又將CR內(nèi)容裝入 CE并繼續(xù)減2計(jì)數(shù)過程，又經(jīng)過 N／2個(gè)CLK脈沖后．CE又為零，使輸出OUT又變成高電平，如此重復(fù)上述過程，在輸出瑞OUT上輸出對(duì)稱方波。 15．答：當(dāng)初始值寄存器中的初始值N是奇數(shù)時(shí)，當(dāng)輸出OUT由低變高時(shí)， CR內(nèi)容先減 1后裝入CE中，然后對(duì) CLK脈沖實(shí)行減2計(jì)數(shù)，直到CE為零時(shí)輸出OUT不立即變低電平，而是再經(jīng)過一個(gè)CLK脈沖后才變?yōu)榈碗娖?#xff0c;此時(shí)OUT保持高電平的時(shí)間為1+(N-1)/2個(gè)CLK脈沖周期之和。當(dāng)輸出OUT輸出由高變低時(shí)，CR內(nèi)容減 1后再裝入 CE中，然后對(duì) CLK脈沖進(jìn)行減 2計(jì)數(shù)，直到CE為零時(shí)立即使輸出OUT輸出變?yōu)楦唠娖?#xff0c;OUT保持低電平時(shí)間為(N-1)/2個(gè)CLK脈沖周期之和，重復(fù)上述過程，在OUT端輸出的波形近似方波。 16．答：方式4特點(diǎn)如下： (1)寫入控制字后輸出OUT變?yōu)楦唠娖阶鳛槌跏茧娖?#xff0c;寫入初始值后，計(jì)數(shù)執(zhí)行獲得初值開始計(jì)數(shù)過程。當(dāng)執(zhí)行部件CE減到0時(shí)，輸出變?yōu)榈碗娖?#xff0c;此低電平持續(xù)一個(gè)時(shí)鐘周期，然后自動(dòng)變?yōu)楦唠娖?#xff0c;并一直維持高電平。 (2)計(jì)數(shù)初始值N要經(jīng)過N個(gè)時(shí)鐘脈沖周期CLK后，才輸出一負(fù)脈沖作為選通脈沖。 (3)GATE=l，進(jìn)行計(jì)數(shù)，GATE=0停止計(jì)數(shù)。維持當(dāng)時(shí)電平，只有計(jì)數(shù)值減為0時(shí)，才產(chǎn)生負(fù)脈沖。 (4)計(jì)數(shù)過程中又寫入新的計(jì)數(shù)值。在下一個(gè)時(shí)鐘周期時(shí)，此計(jì)數(shù)值被寫入執(zhí)行部件，并按新的計(jì)數(shù)值進(jìn)行計(jì)數(shù)過程。常稱軟件觸發(fā)信號(hào)發(fā)生器。 17．答：(l)OUT輸出負(fù)脈沖寬度不同，方式0是N＋ 1個(gè) CLK脈沖周期之和；方式4是一個(gè)CLK脈沖周期。 (2)計(jì)數(shù)期間輸出極性相反，方式0是低電平輸出，方式4是高電平輸出。 18答：方式5特點(diǎn)： (1)寫入控制字后，輸出OUT為高電平。寫入計(jì)數(shù)初始值后，必須有上升沿GATE才在下一個(gè) CLK下降沿裝入 CE，從而進(jìn)行計(jì)數(shù)過程。計(jì)數(shù)為0時(shí)輸出一個(gè)CLK寬度負(fù)脈沖，自動(dòng)變?yōu)楦唠娖?#xff0c;持續(xù)不變。 (2)若計(jì)數(shù)值為N，遇到GATE上升沿時(shí)再經(jīng)過1個(gè)CLK下降沿時(shí)進(jìn)行計(jì)數(shù)過程，再過N時(shí)鐘周期，輸出OUT才出現(xiàn)選通負(fù)脈沖。(3)若計(jì)數(shù)過程又有上升沿 GATE觸發(fā)。則再經(jīng)過下一個(gè)CLK下降沿后重新獲得計(jì)數(shù)值，進(jìn)行計(jì)數(shù)過程。(4)如果計(jì)數(shù)過程中，寫入新的計(jì)數(shù)值，如果無觸發(fā)脈沖GATE輸出不受影響，結(jié)束當(dāng)前計(jì)數(shù)過程后、再受觸發(fā)電平時(shí)，將按新的計(jì)數(shù)值開始計(jì)數(shù)過程。19．答：方式 5與方式 1比較區(qū)別如下：． 兩者均為硬件觸發(fā)啟動(dòng)計(jì)數(shù)器工作方式，但OUT輸出的負(fù)脈沖寬度不同，方式1負(fù)脈沖寬度為計(jì)數(shù)初值N個(gè)CLK 脈沖之和、而方式5的輸出負(fù)脈沖寬度僅為一個(gè)CLK脈沖周期。四、填空題1．可編程定時(shí)／計(jì)數(shù)器；可編程間隔定時(shí)器。2．程序，并行 3．計(jì)數(shù)執(zhí)行；0 4．外圍設(shè)備；時(shí)鐘 5?？刂?#xff1b;中斷請(qǐng)求6．輸入／輸出設(shè)備；輸入／輸出 7．3；計(jì)數(shù)器 8．獨(dú)立；控制字；9．減法；初始值寄存器10．000：40H 11。00l；4lH12．010； 42H 13．011； 43H 14．100；111 15．BCD；二進(jìn)制 16．010； 110 17。011；111 18．00；領(lǐng)存” 19。01；低820． 10；高8 21．低 8；高 8 22．初始值命令；計(jì)數(shù)值命令 23．復(fù)位；初始(高／低電平)24．最大值； 216 25、最大值； 10426．計(jì)數(shù)結(jié)束產(chǎn)生中斷；高 27．低；高28．下降沿；下降沿 29．高；低 30．下一個(gè)CLK下降沿；新的計(jì)數(shù)值31．可重復(fù)觸發(fā)的單穩(wěn)電路； GATE32．高；高 33。上升沿；下降沿 34．不受影響；新的計(jì)數(shù)值 35．周期性；分頻器 36．高電平；高電平 37．000lH；CLK周期 38．同一；自動(dòng) 39．1；0 40．停止；下一個(gè)CLK下降沿 41．變高電和新計(jì)數(shù)值 42．偶數(shù)；對(duì)稱方波 43．奇；近似對(duì)稱方波44 減 2； N／2 45。減1；減2 46．減1；減2 47．N／2； N／2 48．(N-1)/2；(N-1)/2 49。允許計(jì)數(shù)；停止計(jì)數(shù)50．不啟動(dòng)；啟動(dòng) 51。0；低 52．軟件觸發(fā)的選通信號(hào)發(fā)生器；硬件觸發(fā)的選通信號(hào)發(fā)生器 53．0；負(fù) 54。 不受影響； GATE上升沿 55．無；不受 56．GATE觸發(fā)；下降沿, 專業(yè).專注 . 關(guān)?鍵?詞： 接口 技術(shù) 微機(jī) 習(xí)題集 匯總 原理

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總結(jié)

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