C6748_UART(5) - UART寄存器
生活随笔
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C6748_UART(5) - UART寄存器
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1、FIFO控制寄存器(FCR) RXFIFTL:接收FIFO中斷觸發(當FIFO中的數據量剛到達所要求(trigger level)的時候會產生中斷); DMAMODE1:如果FIFO使能的話此位可以使能DMA模式。 TXCLR:發送FIFO清除。 RXCLR:接收FIFO清除。 FIFOEN:FIFO模式使能。 2、隊列控制寄存器(LCR) DLAB:分配鎖存訪問位。 BC:暫停控制。 SP:強制奇偶校驗。 EPS:奇偶校驗選擇。 PEN:校驗使能。 STB:設置產生停止位。 WLS:發送接收字長度,當STB為0,WLS決定停止位的長度。 3、模式控制寄存器 AFE:自動流控使能。 LOOP:回環模式使能。 4、分頻鎖存寄存器(DLL and DLH) DLL和DHH分別是分頻值得高位和低位。 分配值=UART模塊輸入時鐘頻率/波特率/16; 或者:分配值=UART模塊輸入時鐘頻率/波特率/13; 5、電源和仿真管理寄存器(PWREMU_MGMT) SOFT、FREE:特殊的仿真位。高級語言調試程序中出現一個斷點時,該??仿真位決定定時器的狀態。如果FREE位設為1,則當遇到一個斷點時,定時器繼續運行(即自由運行),在這種情況下,SOFT被忽略。但是,如果FREE為0,則SOFT有效。在此情況下,如果SOFT=0,則定時器停止,下一次TIM的值遞減;如果SOFT=1,則當TIM減到0,定時器停止工作。 UTRST:UART發送復位。 URRST:UART接收復位。 6、模式定義寄存器(MDR) OSM_SEL:0(16倍過采樣);1(13倍過采樣)
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